JFET 공통 소스 증폭기
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작성일 22-11-20 16:11
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JFET 공통 소스 증폭기를 구성하여 증폭기의 property(특성) 및 동작 원리를 實驗(실험)을 통하여 쉽게 이해하기 위해 쓴 글입니다.
접지점에 대한 소스 점의 전압은 소스 저항에 드레인 전류를 곱한 값과 같다.
게이트-소스전압
그림 3-1(a)에서 게이트는 역방향으로 바이어스되어 있기 때문에 를 통해서 흐르는 게이트 전류는 무시해도 된다 따라서 접지점에 대한 게이트 전압은 0이다. 이것이 게이트-소스 역 전압을 증가시켜서 채널을 좁게 만들게 되고 드레인 전류를 감소시킨다.
따라서 게이트-소스 전압은 소스 전압과 게이트 전압의 차이이므로 식 (2-1)과 같이 쓸 수 있따
혹은
…(To be continued )
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레포트/공학기술
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다.
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자기 바이어스
그림 2-1(a)는 JFET의 또 다른 바이어스 방법인 자기 바이어스를 나타내고 있따 게이트 전원은 없고 드레인 전원만 공급된다는 것을 유의해야 한다. 이런 definition 은 게이트-소스에 역방향 전압을 만들기 위해서 소스 저항 양단에 걸리는 전압을 사용하는데 있으며, 이것은 마치 쌍극성 transistor(트랜지스터) 에 사용되어진 것과 유사한 국부귀환의 형태와 같다. 이런 귀환은 어떤 동작을 하는가 알아보자.
만약 드레인 전류가 증가하면 가 증가하기 때문에 소스 저항 양단에서의 전압강하도 증가한다.
